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       了解如何在您的 Virtex-4 設計中利用RocketIO. 理解并利用RocketIO 收發器塊的特點，如CRC，8b/10b 編碼，通道綁定，時鐘校正以及逗點探測。其它重點還包括調試技術，采用結構向導，綜
合和實現考慮，標準兼容等。這個全面的課程將實際的動手實驗與講座學習結合在了一起。

        ?? Verilog 或VHDL 經驗或學習過 Verilog 入門或 VHDL 入門課程
        ?? 綜合和仿真經驗
        ?? FPGA 設計經驗或學習過FPGA 設計基礎課程
        ?? 了解高速串行 I/O 協議和標準(SONET、千兆位以太網、Infiniband 等) 更佳

        ?? 有效利用 RocketIO 的所有特點，如CRC、通道綁定、時鐘校正、逗點探測、8b/10b編碼/解碼、可
            編程終止以及預加重
        ?? 利用控制 RocketIO 特性的RocketIO 收發器的端口和屬性
        ?? 采用結構向導將 RocketIO 模塊用于設計中
        ?? 采用 RocketIO，達到與高速I/O 標準的兼容性收發器

        實驗1． 8B/10B
        了解如何采用 8b/10b 編碼器/解碼器并操縱運行不同情況。了解如何旁路8b/10b編碼器/解碼器。
        實驗2． 逗點和K 字符
        了解如何采有可編程的逗點探測來將串行數據流列成一隊。
        實驗3． 循環冗余檢測
        調整設計，無論是在用戶模式還是光纖信道模式都采用 CRC 特點。
        實驗4． 時鐘校正
        了解如何采用時鐘校正邏輯來補償鏈路上收和發之間頻率的不同。
        實驗5． 通道綁定
        調整某個設計來采用 2 個收發器，綁定在一起形成一個真正的通道。
        實驗6． 綜合和實現
        了解采用結構向導來示例 RocketIO 原圖，綜合設計，實現設計。
        實驗7． Aurora 協議引擎
        了解如何用 Aurora 參考設計來發送并接收數據。